簡易檢索 / 檢索結果

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    具數位校正技術及突波降低技術之5-GHz頻率合成器晶片設計
    • 電子工程系 /102/ 碩士
    • 研究生： 陳紹宇   指導教授： 黃進芳
    • 在傳統頻率合成器架構之Charge pump phase lock loop(CPPLL)電路，因其相位頻率偵測器(PFD)之靜態相位誤差以及充電汞電流不匹配，將造成參考頻率突波。本文使用降低靜態相…
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    • 全文公開日期 2019/07/17 (校內網路)
    • 全文公開日期 本全文未授權公開 (校外網路)
    • 全文公開日期 本全文未授權公開 (國家圖書館：臺灣博碩士論文系統)
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